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https://pc.watch.impress.co.jp/docs/news/1288307.html [impress.co.jp] の https://pc.watch.impress.co.jp/img/pcw/docs/1288/307/html/02.jpg.html [impress.co.jp] を見るとDRAMも統合したとありますTSMCの5nmプロセスがDRAM混載可能だったのを初めて知ったチップ全体のトランジスタ数とDRAM部分の面積から想像するに容量せいぜい数百MBという感じなので、SRAMのキャッシュと外部メモリとの間のキャッシュとして使ってるんでしょうか
> TSMCの5nmプロセスがDRAM混載可能だったのを初めて知った
んなわけないでしょ。Appleはオンチップ化なんて言ってないから、見栄えを重視してプレゼン資料上で正方形になるようにブロック図を拡げたのを解釈間違えてるだけなのでは。
https://www.apple.com/jp/newsroom/2020/11/apple-unleashes-m1/ [apple.com]
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「毎々お世話になっております。仕様書を頂きたく。」「拝承」 -- ある会社の日常
M1プロセッサ (スコア:1)
https://pc.watch.impress.co.jp/docs/news/1288307.html [impress.co.jp] の https://pc.watch.impress.co.jp/img/pcw/docs/1288/307/html/02.jpg.html [impress.co.jp] を見るとDRAMも統合したとあります
TSMCの5nmプロセスがDRAM混載可能だったのを初めて知った
チップ全体のトランジスタ数とDRAM部分の面積から想像するに容量せいぜい数百MBという感じなので、SRAMのキャッシュと外部メモリとの間のキャッシュとして使ってるんでしょうか
Re:M1プロセッサ (スコア:0)
> TSMCの5nmプロセスがDRAM混載可能だったのを初めて知った
んなわけないでしょ。Appleはオンチップ化なんて言ってないから、見栄えを重視してプレゼン資料上で正方形になるようにブロック図を拡げたのを解釈間違えてるだけなのでは。
https://www.apple.com/jp/newsroom/2020/11/apple-unleashes-m1/ [apple.com]